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Technologie

Compression H.264 4K

Enciris Technologies développe des solutions pour traitement vidéo de haute performance.

Grâce à nos efforts, nous avons développé, et continuons de développer, un grand nombre de briques de traitement vidéo spécialisée de haute définition ou de définition standard, ainsi que des blocs software et de circuits imprimés.

Ci-dessous un échantillon de nos IPs propriétaires.

Sous certaines conditions, nous brevetons nos produits aux clients désireux de les intégrer à leurs propres produits.

N'hésitez pas à nous contacter si vous désirez obtenir plus d'informations concernant notre procédure de brevetage ou si vous êtes intéressé par nos cartes d'acquisition sur-mesure.

Nous serons très heureux de vous aider à réaliser votre projet.

H.264-HD Encoder Core

H.264-HD Encoder Core

Cliquez ici pour obtenir une brochure (570KB)

Il s'agit d'un noyau de compression IP haute définition ultra performant qui implémente la norme de codage vidéo H.264 en utilisant le profil baseline jusqu'au level 4.1. Seulement 133MHz sont requis pour une compression 1080p à 30fps. Très basse latence de compression. Supporte toutes les résolutions et fréquences d'images. Large fenêtre de recherche pour l'estimation de mouvements : 1024x512. Débits de 64Kbit/s à 80Mbit/s H.264 baseline profile jusqu'au level 4.1. Implémentation simple dans des FPGA low cost.

Cœur IP de décodage H.264 HD

Cliquez ici pour obtenir une brochure (721KB)

Un cœur IP de décompression à haute définition (HD) et à hautes performances, qui met en œuvre la norme de codage vidéo H.264 (MPEG-4/AVC) en utilisant les profils Baseline/Main/High jusqu’au niveau 5.1. Fréquence d’horloge requise de seulement 111,1 MHz pour une décompression 1080p à 30 image/s pour le cœur de décodage, et 150,1 MHz pour les autres cœurs de traitement. Très basse latence. Prise en charge de toutes les résolutions jusqu’à 2048x2048 et de tous les débits. Débits entre 64 kbit/s et 180 Mbit/s. Mise en œuvre possible dans un FPGA à faible coût.

VC-1/WMV-HD Encoder Core

Cliquez ici pour obtenir une brochure (976KB)

Il s'agit d'un noyau de compression IP haute définition ultra performant qui implémente la norme de codage vidéo VC-1 utilisant le advanced profile au level 3. Seulement 133 MHz sont requis pour une compression 1080p30. Très basse latence de compression. Supporte toutes les résolutions et fréquences d'images. Large fenêtre de recherche pour l'estimation de mouvements: 1024x512. Débit allant de 64Kbit/s à 80Mbit/s SMPTE 421M/ VC-1 Advanced profile @ level 3. Implémentation dans des FPGA low cost.

Multiport DDR Memory Core

Cliquez ici pour obtenir une brochure (1.2MB)

Un contrôleur de mémoire multiport DDR (Double Data Rate) conçu pour simplifier la tâche de traitement de multiple flux de données dans et au-dehors de la mémoire DDR SDRAM. Ce noyau est spécialement adapté au traitement vidéo ou à tout autre système à haut flux de données. Optimisé pour les FPGA Lattice ECP2/MTM. Jusqu'a 16 ports d'entrée et 16 ports de sortie. Haute efficience DDR. Facile à configurer. Mobile DDR, DDR1, DDR2 support de transfert 2-De.

Motion Estimation Core

Cliquez ici pour obtenir une brochure (1.2MB)

Un IP complet d'estimation de mouvements spécialement adapté aux formats de compression H.264 et VC-1. Cet IP peut également être utilisé pour la détection de mouvements et tourne à seulement 133 MHz pour du 1080p30. Seulement 540 cycles /macroblock sont requis. Une interpolation 1/4 pixel pour le H.264 ainsi qu'une interpolation 1/2 pixel pour le H.264 sont implémentées. La zone de recherche peut s'étendre jusqu’à 1024x512 pixels. L'IP est implémentable sur des FPGAs de faible coût.

Noyau de prétraitement vidéo

Cliquez ici pour obtenir une brochure (983KB)

Un bloc IP de très haute performance tout-en-un qui répond aux fonctions généralement requises dans le prétraitement vidéo comme le désentrelacement, la réduction d'échelle et la conversion couleur YUV 4:2:2 vers 4:2:0. Filtrage passe-bas. Résolution vidéo arbitraire. Applications HDTV. Haut taux de traitement de pixel. Haute performance dans un FPGA de faible coût.